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第88章 盘古效率革命 － 设计流程的重塑（第1页）

“启明二号”

（phoenix）的成功tape-out，不仅是启明芯在mp3Soc领域迈出的关键一步，更在公司内部，悄然引发了一场关于“效率”

的革命。

这场革命的核心驱动力，正是那个一直被寄予厚望、并在“启明二号”

设计中初露锋芒的自研EdA工具——“盘古”

。

在“启明二号”

项目结束后，李志远带领的“盘古”

EdA团队并没有停歇。

他们立刻对“盘古”

p&R（布局布线）引擎在项目中实际应用的数据和反馈，进行了全面而深入的复盘分析。

而分析的结果，足以让整个公司，尤其是那些曾经对自研EdA持怀疑态度的人，感到震惊。

在一份由李志远亲自撰写、提交给林轩和公司技术委员会，一个由林轩、顾维钧、陈家俊、李志远等核心技术负责人组成的内部决策机构的报告中，一组组详实的数据，清晰地勾勒出了“盘古”

带来的效率提升：

关键模块p&R迭代次数显着减少:报告选取了“启明二号”

中五个复杂度最高、时序最关键的数字模块（包括USb控制器核心、dSp加速单元、存储器控制器接口等）作为样本。

数据显示，在使用商业EdA工具（cadenceSE）时，这些模块为了达到时序收敛目标，平均需要进行8到12次的p&R迭代优化。

而当后端工程师尝试使用“盘古”

p&R引擎后，平均迭代次数骤降至3到4次！

这意味着大量的设计时间和人力被节省下来。

工具运行时间大幅缩短:对于同等规模和复杂度的模块，“盘古”

p&R引擎的平均运行时间，相比市面上的商业工具，缩短了约40%！

这主要得益于其更先进、更优化的核心算法（如林轩启发的启发式模拟退火结合机器学习思想）以及针对启明芯内部服务器集群进行的并行计算优化。

运行时间的缩短，意味着工程师可以更快地得到结果，进行更多的设计尝试，从而加速整个设计进程。

更高质量的设计结果（qoR）:更令人惊喜的是，在某些“硬骨头”

模块上，“盘古”

不仅更快，而且结果更好！

报告中特别提到了两个案例：一个是某个高速接口模块，商业工具反复优化都无法完全消除时序违例，而“盘古”

一次就成功收敛，并留有正裕量；另一个是dSp加速单元，在满足所有时序约束的前提下，“盘古”

生成的布局面积比商业工具小了5%，这意味着更低的芯片成本和功耗。

对设计流程的积极影响:报告还引用了多位参与“启明二号”